FPGA原型系统装配文件:Assign Traces
来源:于博士Jacky 发布时间:2023-05-04 分享至微信
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分配时钟、复位和其他全局输入。 分配test points或probe output以匹配FPGA电路板上的连接器。 分配连接到专用资源或连接器的顶端IO。 在了解电压电平要求的情况下,分配其余的设备间信号。 在每种情况下,对于任何选择的信号,都可能有不止一个候选轨迹。
与信号具有相同端点的任何可用迹线。 如果没有traces符合1中的标准,则traces具有与信号相同的端点,加上最小数量的多余端点。多余的端点意味着FPGA引脚将被浪费。 如果没有trace符合2中的标准,那么我们必须使用信号源FPGA的两个输出引脚将信号分割成两条trace,如下图所示。
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于博士Jacky
Jacky于博士,本硕博均为西安交通大学微电子专业,十年大厂数字芯片验证经验,对芯片设计验证领域有独到见解,是理论与实践兼备的老鸟。“树芯计划”首席讲师,开设数字验证课程,讲课风趣幽默,善于将理论实践结合。
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